靜態(tài)影像壓縮編碼標(biāo)準(zhǔn)JPEG基本模式研究與FPGA實(shí)現(xiàn).pdf_第1頁
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文檔簡介

1、該文研究在XILINX公司的FPGA芯片SPARTAN Ⅱ上實(shí)現(xiàn)JPEG基本模式的壓縮編碼標(biāo)準(zhǔn),選用硬件描述語言Verilog,在開發(fā)工具Foundation4.1集成環(huán)境中完成軟核的綜合、布局布線、芯片映射及仿真驗(yàn)證.文章首先介紹了JPEG基本模式的的壓縮編碼標(biāo)準(zhǔn),然后從總體規(guī)劃的角度介紹了整個系統(tǒng)的內(nèi)部結(jié)構(gòu)、層次劃分及所采用的設(shè)計(jì)方法和編程風(fēng)格.之后對各個模塊的設(shè)計(jì)進(jìn)行了詳細(xì)的描述,并給出了測試數(shù)據(jù)、綜合后的實(shí)現(xiàn)結(jié)果及時序仿真波形圖

2、,并對設(shè)計(jì)進(jìn)行了硬件的下載驗(yàn)證,最后用LEINA圖對整個系統(tǒng)進(jìn)行測試,壓縮后的數(shù)據(jù)用ACDSee軟件識別,得到了正確的結(jié)果.該文對JPEG基本模式中的主要算法,諸如二維DCT變換,Huffman編碼和量化等給出了基于FPGA的硬件描述語言的解決方法.并設(shè)計(jì)了與低速外設(shè)交換數(shù)據(jù)的接口.在系統(tǒng)方案設(shè)計(jì)過程中,對模塊如何合理劃分及各個模塊之間如何協(xié)同工作做了仔細(xì)的推敲,按照自上而下的設(shè)計(jì)方法將各個模塊逐一細(xì)化,各模塊之間通過端口信號通信進(jìn)行連

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