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文檔簡介
1、為了形成具有自主知識產權的16QAM(quadratureamplitudemodulation)數(shù)字解調模塊,同時結合重慶西南集成電路設計有限公司的研發(fā)項目,本文就16QAM數(shù)字解調性能驗證這一課題展開研究。
本文在簡要介紹16QAM調制解調機制的基礎上,深入研究了當前的16QAM數(shù)字解調方案,同時給出了本文的解調方案,并對解調器中的各個子模塊,如匹配濾波器模塊、頻偏觀測器模塊、載波恢復模塊、碼元同步模塊、低通濾波器模塊進行
2、了詳細的設計。在此基礎上成功開發(fā)出了整個解調系統(tǒng)的源代碼。
根據(jù)16QAM數(shù)字解調系統(tǒng)對頻偏的嚴格要求,選取叉積鑒頻器來構建頻率同步環(huán)路;根據(jù)16QAM調制信號的特點,選取平方根升余弦滾降濾波器作為匹配濾波器;根據(jù)載波相位快速跟蹤且抖動較小的要求,選擇改進的判決反饋鑒相器為基礎構建的載波恢復環(huán)路;根據(jù)系統(tǒng)對碼元同步的嚴格要求,選擇基于SquaringTiming算法的前饋碼元同步環(huán)路。在此基礎上,對所提出的16QAM解調方案進
3、行了系統(tǒng)浮點數(shù)仿真、定點數(shù)仿真和FPGA(Field-ProgrammableGateArray)原型驗證,對技術實現(xiàn)中的關鍵技術和難點進行了研究分析和改進優(yōu)化。
本文首先通過比較分析各種解調算法性能,依據(jù)系統(tǒng)參數(shù)要求,確定了符合性能要求的解調方案;其次,建立了系統(tǒng)仿真模型,對解調模型進行了浮點數(shù)仿真,以證明本文的解調系統(tǒng)性能滿足項目的性能指標,在此基礎上為實現(xiàn)低功耗和誤差控制進行了定點數(shù)仿真,再次用VerilogHDL語言對
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